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Thèse de Mme Hend Affes

La thèse de Mme Hend Affes constitue une des contributions importantes du projet HOPE. Dans ce travail, l’approche complète de modélisation au niveau transactionnel d’un power intent et d’un clock intent est définie. La librairie PwClkArch d’objets C++ et SystemC-TLM permet de décrire un power intent et un clock intent de manière séparée d’un modèle fonctionnel SystemC-TLM d’une architecture matérielle. Cette approche est celle développée au niveau RTL suivant le standard UPF. Pour obtenir une simulation complète des aspects fonctionnels et puissance dissipée au niveau transactionnel, il suffit d’inclure le modèle power dans le sc_main() du modèle fonctionnel. L’approche s’applique à des modèles fonctionnels TLM aussi bien AT (prototype virtuel) que LT. La thèse propose également une extension de IP-XACT pour supporter la description d’un power intent et d’un clock intent afin ensuite de générer automatiquement le code de simulation. Enfin, une technique originale de power management est proposée qui complète l’approche pour intégrer la possibilité de réagir dynamiquement aux changements d’états fonctionnels des composants de l’architecture pour déduire des transition d’états power de ces composants, tout en tenant compte des pénalités en temps de changement d’état power.

Le manuscrit de la thèse (en français) :

PDF - 11.5 Mo